Verilog整理笔记之SRAM篇
静态数据存储器SRAM是存储数据比较重要的器件，它由锁存器阵列构成。SRAM外部接口包括片选端口，读允许端口，写允许端口，地址端口，数据输出端口，数据输入端口。在读写数据时，SRAM根据地址信号， ...
原文：Verilog整理笔记之FIFO篇
我想大家都知道，队列是计算机系统中一种比较基本的数据结构。作为队列中的一种，先进先出的FIFO是一种比较常用的存储器单元。FIFO通常有读允许端口 写允许端口 数据输入端口 数据输出端口 FIFO状态端口等信号端口。其中，FIFO状态端口输出当前FIFO的状态 满 未满或空。 位FIFO的功能框图如下。其中，clock为系统时钟信号输入，reset为系统复位信号，read为读数据信号允许信号，w ...
2012-02-22 22:56 2 29917 推荐指数：
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Verilog整理笔记之ROM篇
。 下面附上笔者自己整理的3*4ROM的真值表及其程序。 仅为复习整理。 ...
【FPGA——基础篇】同步FIFO与异步FIFO——Verilog实现
FIFO是英文First In First Out 的缩写，是一种先进先出的数据缓存器，他与普通存储器的区别是没有外部读写地址线，这样使用起来非常简单，但缺点就是只能顺序写入数据，顺序的读出数据， 其数据地址由内部读写指针自动加1完成，不能像普通存储器那样可以由地址线决定读取或写入某个指定的地址 ...
Verilog学习笔记简单功能实现（八）...............同步FIFO
Part 1,功能定义： 用16*8 RAM实现一个同步先进先出（FIFO）队列设计。由写使能端控制该数据流的写入FIFO，并由读使能控制FIFO中数据的读出。写入和读出的操作(高电平有效)由时钟的上升沿触发。当FIFO的数据满和空的时候分别设置相应的高电平加以指示。FIFO是英文First ...
Verilog学习笔记简单功能实现（八）...............异步FIFO
基本原理： 1.读写指针的工作原理 写指针：总是指向下一个将要被写入的单元，复位时，指向第1个单元(编号为0)。 读指针：总是指向当前要被读出的数据，复位时，指向第1个单元(编号为0). 2.FIFO的“空”/“满”检测 FIFO设计的关键：产生可靠 ...
verilog实现之同步FIFO
上一节我们实现RAM的相关知识，也对比了RAM和FIFO的区别；FIFO：先进先出数据缓冲器，也是一个端口只读，另一个端口只写。但是FIFO与伪双口RAM的不同，FIFO为先入先出，没有地址线，不能对存储单元寻址；而伪双口RAM两个端口都有地址线，可以对存储单元寻址。但是FIFO内部 ...
异步fifo的Verilog实现
一、分析 由于是异步FIFO的设计，读写时钟不一样，在产生读空信号和写满信号时，会涉及到跨时钟域的问题，如何解决？ 跨时钟域的问题：由于读指针是属于读时钟域的，写指针是属于写时钟域的，而异步FIFO的读写时钟域不同，是异步的，要是将读时钟域的读指针与写时钟域的写指针不做任何处理 ...
Verilog实现之异步fifo
上节课我们介绍了，同步fifo，感觉就是在双口异步RAM中进行了一些简单的外围操作，加了一些空满标志，内部用指针来进行寻址，从而取消了外部的地址接口。FIFO的一侧是读。一侧是写。所以具有了''wr_en"和"rd_en",一边是写数据，一边是读数据，所以就有了“wr_data ...