實驗1：基於FPGA + adc7928 + FIFO 緩沖8通道數據 + 通過串口打印到PC機（串口連續發送兩個字節）
RTL視圖 設計目標： 通過FPGA控制，輪流切換通道進行ADC讀數據，並將數據暫存到FIFO中，同時讀FIFO中的數據，通過串口打印到PC機端。FIFO采用的是16位寬的，深度用的256個字節。 1、串口設計要點：串口發送模塊，采用連續不間斷的發送兩個字節，這樣一共需要發出 ...
原文：實驗2：基於FPGA + adc7928 + FIFO 緩沖8通道數據 + 通過串口打印到PC機 （串口采樣8位通用模式）
RTL視圖： 此次修改了串口模塊，和FIFO控制模塊。 串口模塊：以后遇到FIFO位寬不管是 位 或 位 或 位 ，串口模塊都可以通用，而不需要根據FIFO的位寬再做相應更改。輸入的data in位寬定義的是 位， 上個 實驗 中data in是定義 位寬，要連續發送兩個 位數據，可參考上一篇文章。 FIFO模塊：增加了一個計數器，控制取數據，fifo 讀出一個數據是 bit的，而串口一次只能發 ...
2021-12-25 16:27 0 745 推薦指數：
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