實驗2：基於FPGA + adc7928 + FIFO 緩沖8通道數據 + 通過串口打印到PC機 （串口采樣8位通用模式）
RTL視圖： 此次修改了串口模塊，和FIFO控制模塊。 串口模塊：以后遇到FIFO位寬不管是8位 或 16位 或 32位 ，串口模塊都可以通用，而不需要根據FIFO的位寬再做相應更改。輸入的data_in位寬定義的是8位， 上個“實驗1”中data_in是定義16位寬，要連續發送兩個 ...
原文：實驗1：基於FPGA + adc7928 + FIFO 緩沖8通道數據 + 通過串口打印到PC機（串口連續發送兩個字節）
RTL視圖 設計目標：通過FPGA控制，輪流切換通道進行ADC讀數據，並將數據暫存到FIFO中，同時讀FIFO中的數據，通過串口打印到PC機端。FIFO采用的是 位寬的，深度用的 個字節。 串口設計要點：串口發送模塊，采用連續不間斷的發送兩個字節，這樣一共需要發出 個bit數據，這樣就避免FIFO讀出 位寬的數據進行分段發 。 首先需要設計第一個計數器，對位寬進行計數，也就是波特率，這里采用 的波 ...
2021-12-22 20:21 1 2739 推薦指數：
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