FPGA基礎學習(3) -- 跨時鍾域處理方法
文章主要是基於學習后的總結。 1. 時鍾域 假如設計中所有的觸發器都使用一個全局網絡，比如FPGA的主時鍾輸入，那么我們說這個設計只有一個時鍾域。假如設計有兩個輸入時鍾，如圖1所示，一個時鍾給接口1使用，另一給接口2使用，那么我們說這個設計中有兩個時鍾域。 2. 亞穩態 觸發器 ...
原文：FPGA跨時鍾域處理方法
跨時鍾域的信號分為兩類，一類是單比特的信號，一類是多比特的信號。這兩類信號無論是快時鍾域到慢時鍾域還是慢時鍾域到快時鍾域，無論是流數據還是控制信號，都可以使用異步FIFO進行同步。因此下文分類的不同情景，每一種情景都可以使用異步FIFO進行同步，后文就不作介紹。但需要注意的是，快時鍾域到慢時鍾域的同步，在使用異步FIFO時，快時鍾域平均流量是不能大於慢時鍾域的處理速度的，否則數據會丟失，這其實與 ...
2021-12-10 13:46 0 199 推薦指數：
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