本文討論的四種常用FPGA/CPLD設計思想與技巧:乒乓操作、串並轉換、流水線操作、數據接口同步化,都是FPGA/CPLD邏輯設計的內在規律的體現,合理地采用這些設計思想能在FPGA/CPLD設計工作種取得事半功倍的效果。FPGA/CPLD的設計思想與技巧 ...
歡迎大家關注我的微信公眾賬號,支持程序媛寫出更多優秀的文章 本文篇章將討論一下的四種常用 FPGA 設計思想與技巧: 乒乓操作 串並轉換 流水線操作 數據接口同步化, 都是 FPGA 邏輯設計的內在規律的體現, 合理地采用這些設計思想能在FPGA設計工作種取得事半功倍的效果。 FPGA 的設計思想與技巧是一個非常大的話題, 由於篇幅所限, 本文僅介紹一些常用的設計思想與技巧, 包括乒乓操作 串並轉 ...
2020-05-10 10:23 0 1021 推薦指數:
本文討論的四種常用FPGA/CPLD設計思想與技巧:乒乓操作、串並轉換、流水線操作、數據接口同步化,都是FPGA/CPLD邏輯設計的內在規律的體現,合理地采用這些設計思想能在FPGA/CPLD設計工作種取得事半功倍的效果。FPGA/CPLD的設計思想與技巧 ...
1.乒乓操作原理 乒乓操作是一個主要用於數據流控制的處理技巧,典型的乒乓操作如圖所示: 外部輸入數據流通過“輸入數據選擇控制”模塊送入兩個數據緩沖區中,數據緩沖模塊可以為任何存儲模塊,比較常用的存儲單元為雙口RAM(Dual RAM),SRAM,SDRAM ...
雙口RAM經常用於跨時鍾域處理,且比FIFO靈活性更大。本文給出一個具體的設計實例,讓大家理解雙口RAM在跨時鍾域處理中乒乓操作的用法。 輸入數據速率20MHz,輸出數據速率100Mhz,使用雙口RAM完成跨時鍾域處理。一次傳輸的數據為1024個,假設數據位寬為8bit,使用兩片寬度為8、深度 ...
PGA的硬件設計不同於DSP和ARM系統,比較靈活和自由。只要設計好專用管腳的電路,通用I/O的連接可以自己定義。因此,FPGA的電路設計中會有一些特殊的技巧可以參考。 1. FPGA管腳兼容性設計 FPGA在芯片選項時要盡量選擇兼容性好的封裝。那么,在硬件電路設計時,就要考慮如何兼容多種芯片 ...
近日根據RF系統,本着節約FPGA內部邏輯資源以及引腳優化的角度,根據計數器的特征,記錄個人的一些偶得。 1. 時鍾分頻 在項目中經常會遇到需要時鍾分頻,除了使用PLL或DLL;有時所需的分頻時鍾較多,不適宜采用過多的PLL或DLL,此時采用計數器即為較好的解決方案 ...
FPGA調試技巧 八月,一直在debug, 編譯,查信號,幾乎沒機會,也沒心思停留下來看點東西,靜心思考,做點筆記。今天,在硬盤上翻到了保存已久,但一直沒想起來讀的一本手冊。這是我初入職場,決定從硬件工程師轉FPGA的崗位時下載的,當時想着要是讀完verilog那些事,FPGA ...
這里記錄一個實際的需要使用乒乓操作的例子:讀sd卡數據的時,在spi的模式下。發送單數據塊的讀取命令,在回應之后會有 512字節的數據。使用乒乓操作,可以用兩個八位的寄存器,就可以完成連續的512字節讀入fifo。但是如果操作不好的話就會出現位置不對的情況。 上圖是讀入fifo的數據 ...
一、 流水線設計 將原本一個時鍾周期完成的較大的組合邏輯通過合理的切割后分由多個時鍾周期完成。該部分邏輯運行的時鍾頻率會有明顯對的提升,提高系統的性能用面積換速度 一個流水線設計需要4個步驟完成一個數據的處理過程,那么從有數據輸入的第一個時鍾周期開始,直到第4個時鍾周期處理完第一個 ...