AXI-Lite總線及其自定義IP核使用分析總結
ZYNQ的優勢在於通過高效的接口總線組成了ARM+FPGA的架構。我認為兩者是互為底層的，當進行算法驗證時，ARM端現有的硬件控制器和庫函數可以很方便地連接外設，而不像FPGA設計那樣完全寫出接口時序和控制狀態機。這樣ARM會被PL端抽象成“接口資源”；當進行多任務處理時，各個PL端IP核 ...
原文：自定義AXI總線形式SPI接口IP核，點亮OLED
一 前言 最近花費很多精力在算法仿真和實現上，外設接口的調試略有生疏。本文以FPGA控制OLED中的SPI接口為例，重新夯實下基礎。重點內容為SPI時序的RTL設計以及AXI Lite總線分析。當然做些項目時可以直接調用Xilinx提供的SPI IP核，這里僅出於練習的目的考慮。 二 接口時序分析 本項目用的OLED型號為UG HSWEG ，核心控制器是SSD 。該芯片支持並口 I C以及SPI接 ...
2019-02-05 11:58 0 1784 推薦指數：
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