Xilinx FPGA高速串行收發器簡介
1 Overview 與傳統的並行實現方法相比，基於串行I/O的設計具有很多優勢，包括：器件引腳數較少、降低了板空間要求、印刷電路板(PCB)層數較少、可以輕松實現PCB設計、連接器較小、電磁干擾降低並具有較好的抗噪能力。 2 高速串行通信中用到的技術 ...
原文：xilinx 高速收發器Serdes深入研究-Comma碼(轉)
一 為什么要用Serdes 傳統的源同步傳輸，時鍾和數據分離。在速率比較低時 lt M ,沒有問題。在速率越來越高時，這樣會有問題由於傳輸線的時延不一致和抖動存在，接收端不能正確的采樣數據，對不准眼圖中點。然后就想到了從數據里面恢復出時鍾去采樣數據，即CDR這樣就不存在延遲不一致的情況，有輕微的抖動也不會影響采樣 恢復的時鍾會隨着數據一起抖動 。 二 為什么要用 b b, b b 提供足夠的跳變 ...
2018-11-01 15:29 0 844 推薦指數：
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