基於FPGA的異步FIFO設計
今天要介紹的異步FIFO，可以有不同的讀寫時鍾，即不同的時鍾域。由於異步FIFO沒有外部地址端口，因此內部采用讀寫指針並順序讀寫，即先寫進FIFO的數據先讀取（簡稱先進先出）。這里的讀寫指針是異步的，處理不同的時鍾域，而異步FIFO的空滿標志位是根據讀寫指針的情況得到的。為了得到正確的空滿標志位 ...
原文：異步fifo設計（1）
異步fifo的設計主要涉及讀寫指針的產生，空滿狀態的判斷 一：簡單講解 重要參數：fifo深度 簡單來說就是需要存多少個數據 fifo位寬 每個數據的位寬 FIFO有 同步和 異步兩種，同步即讀寫時鍾相同，異步即讀寫時鍾不相同 同步FIFO用的少，可以作為數據緩存 異步FIFO可以解決跨時鍾域的問題，在應用時需根據實際情況考慮好fifo深度即可 本次要設計一個異步FIFO，深度為 ，位寬也是 二： ...
2018-07-04 19:52 1 1915 推薦指數：
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