#ifdef #else #endif 的用法
的說明，在這里就不詳述了。這里主要是對條件編譯（#ifdef,#else,#endif,#if等）進行說 ...
原文：`ifdef、`else、`endif 用法
一般情況下，Verilog HDL源程序中所有的行都參加編譯。但是有時候希望對其中的一部份內容只有在條件滿足的時候才進行編譯，也就是對一部分內容指定編譯的條件，這就是 條件編譯 。有時，希望當滿足條件時對一組語句進行編譯，當條件不滿足時則對另外一組語句進行編譯。 條件編譯命令的幾種形式： ifdef宏名 標識符 程序段 else 程序段 endif 它的作用是當宏名已經被定義過 此處需要采用 d ...
2018-05-16 17:12 0 3002 推薦指數：
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