原文:FPGA中將十進制數在數碼管中顯示(verilog版)--二進制轉換為BCD碼

這周有朋友問怎樣在fpga中用數碼管來顯示一個十進制數,比如 。每個數碼管上顯示一位十進制數。如果用高級語言來分離各位,只需要分別對該數做 , , 對應的取商和取余即可分離出千百十個位。但是FPGA做除法非常耗資源。有沒有其它解決辦法 因為用verilog寫程序時雖然形式上可以寫為比如 ,但是實際存儲對應的還是 H,且一個數碼管只能顯示一個十進制數。因此這個問題相當於二進制如何轉換為一個BCD B ...

2017-04-16 15:12 0 12559 推薦指數:

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