本編文章的目的主要用簡明的方法在純PS里對DDR3進行讀寫。 本文所使用的開發板是Miz701 PC 開發環境版本:Vivado 2015.4 Xilinx SDK 2015.4 10.0本章難度系數★☆☆☆☆☆☆ 10.1 搭建硬件工程 Step1:新建一個名為 ...
本編文章的目的主要用簡明的方法在純PS里對DDR 進行讀寫。 本文所使用的開發板是Miz PC 開發環境版本:Vivado . Xilinx SDK . . 本章難度系數 . 搭建硬件工程 Step :新建一個名為為Miz sys的工程 Step :選擇RTL Project 勾選Do not specify source at this time Step :由於Miz 兼容zedboard ...
2016-09-25 14:55 0 2182 推薦指數:
本編文章的目的主要用簡明的方法在純PS里對DDR3進行讀寫。 本文所使用的開發板是Miz701 PC 開發環境版本:Vivado 2015.4 Xilinx SDK 2015.4 10.0本章難度系數★☆☆☆☆☆☆ 10.1 搭建硬件工程 Step1:新建一個名為 ...
本篇文章目的是使用Block Memory進行PS和PL的數據交互或者數據共享,通過zynq PS端的Master GP0端口向BRAM寫數據,然后再通過PS端的Mater GP1把數據讀出來,將結果打印輸出到串口終端顯示。 涉及到AXI BRAM Controller 和 Block ...
本篇文章目的是使用Block Memory進行PS和PL的數據交互或者數據共享,通過zynq PS端的Master GP0端口向BRAM寫數據,然后再通過PS端的Mater GP1把數據讀出來,將結果打印輸出到串口終端顯示。 涉及到AXI BRAM Controller 和 Block ...
本篇文章主要介紹外設(PL)產生的中斷請求,在PS端進行處理。 在PL端通過按鍵產生中斷,PS接受到之后點亮相應的LED. 本文所使用的開發板是Miz702 PC 開發環境版本:Vivado 2015.4 Xilinx SDK 2015.4 13.0本章難度系數★★☆☆☆☆☆ 13.1 ...
本編文章的目的主要用簡明的方法對DDR3進行讀寫,當然這種方式每次讀寫都需要CPU干預,效率是比較低的,但是這是學習的過程吧。 本系列文章盡可能的讓每一個實驗都相對獨立,過程盡可能保證完整性,保證實驗的可重現性。 但是用到的模塊或者IP的具體作用和用法不保證都重復詳細的介紹。 本文所使用 ...
DDR3讀寫時序 1.DDR3時序參數 意思是說,當我們選擇了187E芯片的時候,他所能支持的最大速率是1066MT/s,即DDR3的時鍾頻率是533MHz。此時tRCD=7 tRP=7 CL=7。 時鍾周期 ...
MiZ702教程+例程 網盤鏈接: http://pan.baidu.com/s/1sj23yxv 不時會跟新版本,增加勘誤之類的,請關注~~ ...
和 DDR2 的設計類似,在 DDR3_burst 的基礎上,添加 FIFO,打造一個可以自動讀寫的 DDR3 控制器,讓其能夠方便的適用於不同的場合。 一、DDR3_ctrl 1、架構 由架構圖可以看出,DDR3_ctrl 模塊由寫FIFO、讀FIFO ...