zedboard如何從PL端控制DDR讀寫(三)——AXI-FULL總線調試
之前的項目和培訓中，都只用到了AXI-Lite或者AXI-Stream，對於AXI-FULL知之甚少，主要是每次一看到那么多接口信號就望而卻步了。 現在為了調試DDR，痛下決心要把AXI-FULL弄懂。 前面已經介紹了基本的接口信號，本文主要是總結一下使用AXI-FULL調試的過程 ...
原文：zedboard如何從PL端控制DDR讀寫(二)——AXI總線
雖然Xilinx已經將和AXI時序有關的細節都封裝起來，給出了官方IP和向導生成自定義IP，用戶只需要關注自己的邏輯實現，但是還是有必要簡單了解一下AXI的時序，畢竟咱是做硬件設計的。 AXI Advanced eXtensible Interface 是一種總線協議，該協議是ARM公司提出的AMBA Advanced Microcontroller Bus Architecture . 協議中最 ...
2016-07-16 17:31 0 4724 推薦指數：
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轉載：原文 http://www.eefocus.com/antaur/blog/17-08/423751_6cc0d.html 0. 引言 通過之前的學習，可以在PL端創建從機模式的AXI接口IP核。但是從機模式是被動 ...