UVM中的regmodel建模(二)
UVM的寄存器模型，對一個寄存器bit中有兩種數值，mirror值，盡可能的反映DUT中寄存器的值。expected值，盡可能的反映用戶期望的值。 幾種常用的操作： read/write：可以前門訪問也可以后門訪問，如果在env的頂層定義過uvm_auto_predict(1)，則UVM會在 ...
原文：UVM中的regmodel建模(一)
UVM中的regmodel繼承自VMM的RAL Register Abstract Layer ，現在可以先將寄存器模型進行XML建模，再通過Synopsys 家的工具ralgen來直接生成regmodel，提供后門訪問，十分方便。 寄存器模型建模： 定義一個寄存器，如下 也可以在該class中定義covergroup，sample的function等。在以后的component中在采樣。 cla ...
2015-04-29 17:14 0 5764 推薦指數：
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