用Sublime Text搭建簡易IDE編寫Verilog代碼
前言 Verilog是一種硬件描述語言（HDL），該語言在Windows上有集成開發環境可以使用，如ModelSim，但ModelSim的編輯器不太好用因此筆者萌生了用Sublime Text3來編寫Verilog的想法。下面我們將圍繞着Sublime Text3搭建起一個簡易的IDE， 我將盡 ...
原文：編寫簡易IDE
由於最近工作不是很多 索性又寫了一個簡易性的IDE 很多功能還在完善中。 工具主要有SQL設計器 Form設計器 代碼設計器構成 界面原理： 采用MS的DesignSurface組件實現界面設計器 在通過DesignSurface生成界面的XML 並對XML進行解析 再通過反射生成界面組件 以下是部分代碼 ype rootComponentType typeof Form DesignSurfac ...
2013-05-28 16:56 2 3086 推薦指數：
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