原文:modelsim仿真中 do文件的寫法技巧

Modelsim之 DO文件簡介 網上的關於DO文件的編寫好像資料不多,比較雜,所以本人總結一下常用的簡單語法,方便大家查看。其實本人也剛接觸DO文件沒多久,有紕漏很正常,歡迎指正批評,互相學習。PS:寫得有點亂 還有一個值得注意的是 我在看到這篇文章的時候我正在仿真一個verilog文件,文件中調用了一個ROM , 但是我怎么仿真 rom的輸出文件都有問題, 經過一個QQ好友的指點,我發現竟然是 ...

2013-01-14 13:34 0 18094 推薦指數:

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利用do文件方式進行modelsim仿真

舉例的工程是一個加法器,待測試功能模塊是add.v,測試激勵是tb_add.v,do文件是tb.do 下面直接附上主要步驟: (1)首先新建文件夾,如sim_add,在該文件夾下再新建3個文件夾,分別是:sim、tb、src sim:modelsim的工程文件存放,如tb.do tb:測試 ...

Mon Aug 21 18:54:00 CST 2017 0 3050
modelsim腳本仿真中、Wave窗口問題

Modelsim中 view -new-title {*--*} 不能夠單獨打開窗口 例如: 四個add view都只能顯示在一個窗口中 最后發現是版本的問題: 上面使用的是 Modelsim - DE 的版本, 出現不兼容的問題。 需要 ...

Mon Mar 23 20:13:00 CST 2020 0 649
Quartus/Modelsim調試仿真技巧

前幾天朋友跟我分享了一些特別好用的調試技巧: 1)System Sources and Probes Editor 類似於模擬激勵輸入的功能,這段時間一直在做一個電機的驅動,板上沒有額外加按鍵觸發,如果初始化時間不夠長,串口調試助手一直捕捉不到上電初始化的數據發送,這個功能 ...

Thu Jul 25 18:47:00 CST 2019 0 590
Modelsim中使用TCL腳本編寫do文件實現自動化仿真

通常我們使用Modelsim進行仿真,是通過圖形界面點點點來進行操作,殊不知Modelsim完美支持TCL腳本語言及批處理命令do文件。簡單來說就是從你修改完代碼后到你重新編譯把需要的信號拉出來查看,現在只需要一個動作即可完成。大大提高了工作效率,博主之前也是點點點了好久,最后 ...

Sun Apr 01 19:13:00 CST 2018 0 2678
仿真激勵文件Modelsim仿真測試

前言 TestBench模塊沒有輸人輸出,在TestBench模塊內實例化待測設計的頂層模塊,並把測試行為的代碼封裝在內,直接對測試系統提供測試激勵。 基本的Textbench結構: 我們還 ...

Tue Oct 12 19:05:00 CST 2021 0 863
verilog modelsim文件進行仿真讀寫

當需要對大量數據進行仿真驗證時,可使用文件的讀寫方式驗證; 1.仿真文件讀取($readmemb,$readmemh) 1.1二進制文件讀取 (1)$readmemb("<數據文件名>",<存儲器名>); (2)$readmemb("<數據文件名> ...

Sat Jun 05 03:38:00 CST 2021 0 1731
仿真】后仿真中的notifier是奏啥滴!

在進行后仿真的時候,我們經常會發現有人在仿真命令中增加了“+no_notifier”,從而使輸出不定態導致的功能異常出現的情況神奇的消失了。那么,到底是為什么會出現這種情況呢?本文將以示例說明notifier到底是干啥滴! Notifier在英文中的意思是通知人、通告人,在后仿真過程中 ...

Mon Jul 05 01:01:00 CST 2021 2 297
 
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