FPGA中的ODDR2的使用
ODDR2整体结构如下图： ODDR2真值表 相关说明：转载：http://blog.sina.com.cn/s/blog_6ad065eb0101krwj.html http://blog.sina.com.cn/s ...
原文：ODDR使用注意
最近项目用到了千兆以太网，PHY通过ZYNQ的PL管脚进入FPGA后，直接连到PS端的MAC，PL端使用ODDR保证MAC发送的Tx信号到PHY的接收时序， PHY用的是TI的DP ，没注意这货在GMII的模式下不能调整clock和Data的相位关系，结果FPGA保证了沿对齐，PHY也是沿对齐去采集，导致不同批次的硬件表现不一致 血的教训啊。 记录下ODDR的输出模式： clk wire和输出的 ...
2021-01-14 18:42 0 389 推荐指数：
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