DDR2（3）：自定义读写控制器和DDR2 IP信号说明
官方的例程还是比较难懂，现在试着在上次的工程上进行修改，做一个简单的读写测试。 一、新建顶层工程 建立工程 top.v，其效果即原先的 DDR2_example_top.v，记得右键设置为顶层模块，主要修改了以下几点： （1）端口信号名字； （2）增加 PLL 生成 100Mhz ...
原文：DDR信号、结构
DDR 信号 BA : address bus bank BA : address bus bank BG: bank group multi channel: 一个channel对应一个DDR controller，不同的channel之间工作是相互独立的。 rank：在一个channel下，可以有多个rank，不同的rank有其独立的CS CKE，但是一个channel下的不同rank的数据 ...
2020-10-12 19:47 0 407 推荐指数：
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