在一个数字系统中往往需要多种频率的时钟脉冲作为驱动源，这样就需要对FPGA的系统时钟（频率太高）进行分频。分频器主要分为奇数分频，偶数分频，半整数分频和小数分频，在对时钟要求不是很严格的FPGA系统中，分频器通常都是通过计数器的循环来实现的。 偶数分频：假设为N分频，由待分频的时钟触发计数器计数 ...

在分频器电路中最重要的概念有两个；1）奇分频/偶分频；2）占空比。 A)其中最简单的就是二分频电路，占空比为50%，其Verilog程序为 波形图如下所示： B)采用计数器实现计数分频（偶数）占空比为50%，如实现40分频，程序如下： 波形图 ...

1.整数分频电路，无占空比要求 对于偶数，N分频电路，只需实现一个N/2个状态的计数器即可，触发器 采到计数器为N/2-1时，将clk_out取反。 对于奇数，N分频电路，可用状态机实现，前几个状态输出0，后几个状态输出1；也可用计数器实现，比如7分频电路，计数器从0到6循环 ...

一、引言 　　在数字逻辑电路设计中，分频器是一种基本的电路单元。通常用来对某个给定频率进行分频，以得到我们想要的频率。在FPGA中，我们一般都是通过计数器来实现分频，分频得到的时钟质量没有通过PLL得到的时钟质量好，用于对时钟信号要求较高的逻辑设计中，还是用PLL分频比较好。下面将详细介绍任意 ...

在学习FPGA的过程中，最简单最基本的实验应该就是分频器了， 同时分频器也是FPGA设计中使用频率非常高的基本设计之一， 尽管在芯片厂家提供的IDE中集成了锁相环IP， 如altera 的PLL，Xilinx ISE的DLL或者vivado中的clock来进行时钟的分频，倍频以及相移 ...

占空比：对于一串理想的脉冲序列中（如方波），正脉冲的持续时间与脉冲总周期的比值，叫做这个方波的占空比。 分频分为奇分频和偶分频 第一,偶数倍分频：偶数倍分频应该是大家都比较熟悉的分频,通过计数器计数是完全可以实现的。如进行N倍偶数分频,那么可以通过由待分频的时钟触发 计数器计数,当计数器 ...

在FPGA的学习过程中，最简单最基本的实验应该就是分频器了。由于FPGA的晶振频率都是固定值，只能产生固定频率的时序信号，但是实际工程中我们需要各种各样不同频率的信号，这时候就需要对晶振产生的频率进行分频。比如如果FPGA芯片晶振的频率为50MHz，而我们希望得到1MHz的方波信号，那么就需要对晶 ...

有时在基本模块的设计中常常会使用到时钟分频，时钟的偶分频相对奇分频来说比较简单易于理解，但是奇分频的理念想透彻后也是十分简单的，本文就针对奇分频做一个记录并列出了 modelsim 的仿真结果。 奇分频 其实现很简单，主要为使用两个计数模块分别计数，得到两个波形进行基本与或操作完成。一个 ...