C6678的PLL模块设置
这部分讲解的是Main PLL和 PLL Controller的配置，主要介绍怎样提供DSP核 C66X CorePac需要的工作时钟；C6678除了Main PLL，还有 DDR3 PLL、PASS PLL。 1、Keystone1架构 C6678: Main PLL and PLL ...
原文：CPU缓存学习及C6678缓存使用总结（知识归纳）
作者注： .本篇博客内容是本人在学习cpu缓存原理时进行的学习总结，参考了多处相关资源 书籍，视频，知乎回答等 ，参考出处标注在内容最后。 .由于本篇内容的编辑工作在印象笔记完成，输出的PDF文件无法上传到博客编辑器中，所以将PDF转化为多个图片，通过图片嵌入博客内，所以内容之间存在大片空白，给各位造成不好的浏览体验，敬请谅解。 .由于是学习阶段，若内容出现错误，请各位大佬批评指正。 ...
2020-05-28 22:23 0 566 推荐指数：
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关于C6678的网口问题
1、C6678 Keystone1架构的GbE switch subsystem如图所示： 2、从图中可以看到MAC层与物理层PHY芯片的连接接口是由SGMII+SerDES构成，SGMII是以太网MAC与PHY之间的媒体接口，SerDES为可编程的串行接口，为差分输入输出。 3、网上 ...
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