DC学习（6）基本时序约束之路径2时钟的建模与约束
参考http://www.cnblogs.com/IClearner/p/6440488.html 一：时钟/时钟树的属性 1：时钟树： 一般的时钟，我们都指的是全局时钟，全局时钟在芯片中的体现形式是时钟树。 时钟树，是个由许多缓冲单元(buffer cell)平衡搭建的时钟 ...
原文：DC（三）——时钟约束
时钟约束相关概念 建立时间Tsetup：时钟有效沿到来之前，数据需要保持稳定的时间，否则触发器无法锁存数据。 保持时间Thold：在时钟有效沿到来之后，数据需要保持稳定的时间，否则触发器无法锁存数据。 亚稳态semi stable state：在数据的建立时间和保持时间中对信号进行采样，导致输出无法预测的状态。 时钟树属性概念 时钟树相关属性对于时钟的影响如下图所示。 时钟偏移 clock ske ...
2020-05-26 16:34 0 1613 推荐指数：
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转载：https://www.cnblogs.com/IClearner/p/6440488.html 最近做完了synopsys的DC workshop，涉及到时钟的建模/约束，这里就来聊聊数字中的时钟（与建模）吧。主要内容如下所示： ·同步电路与异步电路； ·时钟/时钟树 ...