[笔记]ISE中FIFO和DDR3
基于FPGA内部的FIFO设计 来源：http://www.dzsc.com/data/html/2008-9-16/69183.html 在FPGA设计中，内部的FIFO设计是 个不可或缺的内容，其设计的质师会直接影响FPGA的逻辑容量和时序。在Xilinx中的某些高端器件是内置 ...
原文：DDR3中的ODT（On-die termination）
ODT是什么 为什么要用ODT 在查阅了很多资料并仔细阅读DDR 的官方标准 JESD A 之后，下面来整理整理。 首先ODT是什么 ODT On Die Termination ，是从DDR SDRAM时代开始新增的功能。其允许用户通过读写MR 寄存器，来控制DDR SDRAM中内部的终端电阻的连接或者断开。在DDR SDRAM中，ODT功能主要应用于： DQ, DQS, DQS and DM ...
2020-03-24 19:48 0 810 推荐指数：
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DDR3频率自适应 FRC理解！ 参考来源：http://www.cnblogs.com/TFH-FPGA/archive/2012/08/31/2665759.html 转帖注意： uniphy：IP核设置步骤： Memory clock frequency：给DDR的时钟频率 ...
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DDR3调试总结
DDR3调试总结 本文为原创，转载请注明作者与出处 http://blog.csdn.net/hanfei_1/article/details/70546010 以前同是DDR3的无知少年，由于项目需求、工作需要，有幸深入研究DDR3，中间也确实历经各种盲目阶段，查询资料、建立 ...