systemverilog学习（3）基本数据类型
主要内容：4-state，2-state，固定数组 一：基本数据类型 1：sv的位扩展 2：4-state sv里面使用logic来代替verilog里面的reg，有4值：0，1，x，z reg不可用于连续赋值语句，但logic可用于连续赋值语句；但logic不能用 ...
原文：systemverilog数据类型
，logic类型： verilog中最常使用的数据类型是变量 reg 和线网 wire ，在编码或测试的时候经常需要区分两种数据类型的不同使用方法。在SV中定义logic可以取代这两种数据类型。 logic不仅能够作为变量，而且可以被连续赋值，门单元和模块所驱动。但是logic不能够被多个结构体驱动。下面这段代码展示了logic的使用方法。 module logic test input log ...
2020-01-08 21:55 0 1655 推荐指数：
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