xilinx DMA IP核(二) —— 文档阅读
本笔记不记录DMA的Scatter/Gather特性。DMA上有三种总线：AXI4-LIte（对寄存器进行配置），AXI4-Memory Map（用于与内存交互）和AXI4 Stream（用于与外设交互）。在寄存器模式下，寄存器分为两部分：MM2S和S2MM，每个部分包括Control ...
原文：xilinx DMA IP核(一) —— loop测试 代码注释
本篇笔记中的代码来自：米联科技的教程 第三季第一篇的DMA LOOP环路测试 硬件的连接如下图所示： 图：DMA Loop Block Design 橘色的线就是DMA加FIFO组成的一个LOOP循环，红色圈圈是AXI LITE的控制和两个读写完成的中断。 米联科技教程提供的该测试代码文件是以下四个，我删除了其中关于OLED的部分。 图：DMA Loop 测试源码结构 .重要的结构体 . .中断 ...
2019-02-11 14:32 0 2489 推荐指数：
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