FPGA中亚稳态相关问题及跨时钟域处理
前言 触发器输入端口的数据在时间窗口内发生变化，会导致时序违例。触发器的输出在一段时间内徘徊在一个中间电平，既不是0也不是1。这段时间称为决断时间（resolution time）。经过resolu ...
原文：异步FIFO跨时钟域亚稳态如何解决？
跨时钟域的问题：前一篇已经提到要通过比较读写指针来判断产生读空和写满信号，但是读指针是属于读时钟域的，写指针是属于写时钟域的，而异步FIFO的读写时钟域不同，是异步的，要是将读时钟域的读指针与写时钟域的写指针不做任何处理直接比较肯定是错误的，因此我们需要进行同步处理以后进行比较。 解决方法：两级寄存器同步 格雷码 同步的过程有两个： 将写时钟域的写指针同步到读时钟域，将同步后的写指针与读时钟域的 ...
2018-09-18 08:14 0 779 推荐指数：
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