原文:SystemVerilog中枚举类型注意事项

在SystemVerilog枚举类型中当使用logic进行声明时,注意logic为四态,所以当使用时如果声明时需要x z态需要显式声明。 如果X或者Z赋值给枚举列表中的一个标签,下一个标签也必须被显式的赋值。试图由赋为X或者Z的标签的值加 来自动获得值是错误的。 一个枚举型只可以进行下列赋值: 枚举类型列表中的一个标签 同类枚举型的其他变量 即使用相同的枚举类型声明变量 通过cast转换成枚举类 ...

2018-03-05 11:30 0 3192 推荐指数:

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typescript 类型注意事项

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