数字IC前后端设计中的时序收敛（四）--Max Capacitance违反的修复方法
本文转自：自己的微信公众号《数字集成电路设计及EDA教程》 里面主要讲解数字IC前端、后端、DFT、低功耗设计以及验证等相关知识，并且讲解了其中用到的各种EDA工具的教程。 考虑到微信公众平台上面发布的很多推文百度搜索不到，所以以后的推文也会在这里进行转载。 数字IC设计中 ...
原文：数字IC前后端设计中的时序收敛（五）--Max Transition违反的修复方法
本文转自：自己的微信公众号 数字集成电路设计及EDA教程 里面主要讲解数字IC前端 后端 DFT 低功耗设计以及验证等相关知识，并且讲解了其中用到的各种EDA工具的教程。 考虑到微信公众平台上面发布的很多推文百度搜索不到，所以以后的推文也会在这里进行转载。 数字IC设计中max cap和max tran这类逻辑DRC或者说时序DRC是在设计中必须修复的问题，到最后版图完成，这些问题都是要clean ...
2017-12-01 11:25 0 4455 推荐指数：
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