RTL视图 设计目标： 通过FPGA控制，轮流切换通道进行ADC读数据，并将数据暂存到FIFO中，同时读FIFO中的数据，通过串口打印到PC机端。FIFO采用的是16位宽的，深度用的256个字节。 1、串口设计要点：串口发送模块，采用连续不间断的发送两个字节，这样一共需要发出 ...

串口发送端verilog代码分析 仿真结果： ...

51单片机串口通信 环形缓冲区队列最近在做毕业设计刚好涉及到51单片机，简单的研究一下发现51单片机串口只有一个字节的缓存，如果遇到单片机串口中断没有及时处理SBUF的值或者串口中断长时间未退出很容易照成数据丢失，于是就自己写了个缓冲区，代价就是消耗一部分内存空间，时间-空间本来就是一对矛盾体，想 ...

一、分析 由于是异步FIFO的设计，读写时钟不一样，在产生读空信号和写满信号时，会涉及到跨时钟域的问题，如何解决？ 　　跨时钟域的问题：由于读指针是属于读时钟域的，写指针是属于写时钟域的，而异步FIFO的读写时钟域不同，是异步的，要是将读时钟域的读指针与写时钟域的写指针不做任何处理 ...

　　　上一节我们实现RAM的相关知识，也对比了RAM和FIFO的区别；FIFO：先进先出数据缓冲器，也是一个端口只读，另一个端口只写。但是FIFO与伪双口RAM的不同，FIFO为先入先出，没有地址线，不能对存储单元寻址；而伪双口RAM两个端口都有地址线，可以对存储单元寻址。但是FIFO内部 ...

　　上节课我们介绍了，同步fifo，感觉就是在双口异步RAM中进行了一些简单的外围操作，加了一些空满标志，内部用指针来进行寻址，从而取消了外部的地址接口。FIFO的一侧是读。一侧是写。所以具有了''wr_en"和"rd_en",一边是写数据，一边是读数据，所以就有了“wr_data ...

FIFO是一种先进先出的数据缓存器，他与普通存储器相比： 　　优点：没有外部读写地址线，这样使用起来非常简单； 　　缺点：只能顺序写入数据，顺序的读出数据， 其数据地址由内部读写指针自动加1完成，不能像普通存储器那样可以由地址线决定读取或写入某个指定的地址。 根据FIFO工作的时钟域 ...

感谢 知乎龚大佬 打杂大佬 网上几个nice的博客（忘了是哪个了。。。。） 前言 虽然FIFO都有IP可以使用，但理解原理还是自己写一个来得透彻。 什么是FIFO？ Fist in first out。先入先出的数据缓存器，没有外部读写地址线，可同时读写。 规则：永远不要写一个已经 ...