FPGA静态时序分析模型——寄存器到寄存器
1. 适用范围 本文档理论适用于Actel FPGA并且采用Libero软件进行静态时序分析（寄存器到寄存器）。 2. 应用背景 静态时序分析简称STA，它是一种穷尽的分析方法，它按照同步电路设计的要求，根据电路网表的拓扑结构，计算并检查电路中每一个DFF（触发器）的建立和保持时间 ...
原文：FPGA两种寄存器的使能
在FPGA中，寄存器的使能设计一般有两种方式： .直接使用寄存器的使能端口。 .使用一个数据选择器连接寄存器的D端口，通过数据选择器的sel端口做使能。如下图 这个方式与直接使用寄存器的CE端口有什么区别呢 我们可以看出来， .在Q 为输出端口时，此时这个结构所具有的功能和普通的寄存器是一样的，当CE 时，D经过数据选择器选通在经过一个时钟的延迟后到达Q 端口。CE 时具有保存功能。是不是就是下面 ...
2017-05-11 21:26 0 2573 推荐指数：
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