原文:FPGA中将十进制数在数码管中显示(verilog版)--二进制转换为BCD码

这周有朋友问怎样在fpga中用数码管来显示一个十进制数,比如 。每个数码管上显示一位十进制数。如果用高级语言来分离各位,只需要分别对该数做 , , 对应的取商和取余即可分离出千百十个位。但是FPGA做除法非常耗资源。有没有其它解决办法 因为用verilog写程序时虽然形式上可以写为比如 ,但是实际存储对应的还是 H,且一个数码管只能显示一个十进制数。因此这个问题相当于二进制如何转换为一个BCD B ...

2017-04-16 15:12 0 12559 推荐指数:

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