最近阿威也在玩MIG ,然后对我问了一大堆问题,主要针对MIG的时钟。后来发现自己理解得还是不够。这么一讨论更加清晰了,做个笔记吧。 第一个时钟,也就是MIG 对DDR接口的时钟。因为我用的是ddr3,K7的器件。所以选择了800M,那么也就是说我请求 ...
最近在玩KC 上的ddr .开始信誓旦旦的说要自己写controller。 于是开始读datasheet,在镁光的官网上弄了一个ddr 的module的仿真模型,仿真读写有效的之后就屁颠屁颠的跑的群里问大家这个clock怎么匹配。然后才知道有PHY这个东西,不用PHY就玩ddr,秀逗了 下面的过程以及结论也许对于有些人也有些秀逗,但是对于我这个初玩ddr的人来说,它还真的卡了我一个星期了。 先用 ...
2017-04-05 12:03 1 1930 推荐指数:
最近阿威也在玩MIG ,然后对我问了一大堆问题,主要针对MIG的时钟。后来发现自己理解得还是不够。这么一讨论更加清晰了,做个笔记吧。 第一个时钟,也就是MIG 对DDR接口的时钟。因为我用的是ddr3,K7的器件。所以选择了800M,那么也就是说我请求 ...
前面已经把DDR用app接口的方式控制住了,结果这个工程确要用microblaze。所以还要接到axi上。于是又来了一段苦逼的路程。 要用axi控制ddr,先得把接口给弄清楚了,各个接口干嘛的。把mig上的axi接口全部复制出来。再一个个的查 ...
网上有位大神写了《xilinx平台DDR3设计教程之XX篇》,一共五篇。稍微百度一下就能出来。最后也给出了具体的app接口的控制方式,只是没有code而已。这里做个小笔记,表示自己的实现方案 ddr3_app_ctrl 是app控制器 wdata_in 仅仅是将 16bit的有效数据 ...
Vivado中的MIG已经集成了modelsim仿真环境,是不是所有IP 都有这个福利呢,不知道哦,没空去验证。 第一步:使用vivado中的MIG IP生成一堆东西 ,这个过程自己百度。或 ...
DDR3调试总结 本文为原创,转载请注明作者与出处 http://blog.csdn.net/hanfei_1/article/details/70546010 以前同是DDR3的无知少年,由于项目需求、工作需要,有幸深入研究DDR3,中间也确实历经各种盲目阶段,查询资料、建立 ...
FPGA DDR3调试 Spartan6 FPGA芯片中集成了MCB硬核,它可以支持到DDR3。在Xilinx的开发工具Xilinx ISE中提供了MIG IP核,设计者可以用它来直接生成 DDR3 控制器设计模块,并通过 MIG 的 GUI 图形界面完成相关配置。 首先,建立ISE工程 ...
本文为原创,转载请注明作者与出处 http://blog.csdn.net/hanfei_1/article/details/70546010 以前同是DDR3的无知少年,由于项目需求、工作需要,有幸深入研究DDR3,中间也确实历经各种盲目阶段,查询资料、建立工程、调试 ...
最近针对黑金的光纤开发板上的DDR3进行了代码学习及板级调试。该模块功能流程已经搞清楚,以后针对DDR3的控制模块可以直接修改调用了,哦也! 有几个需要注意的细节列举如下: (1)整个DDR3控制模块的架构要清楚,方便以后使用(数据的产生源和消耗源); 首先说明整个DDR3的工程模块 ...