Verilog学习笔记简单功能实现（八）...............同步FIFO
Part 1,功能定义： 用16*8 RAM实现一个同步先进先出（FIFO）队列设计。由写使能端控制该数据流的写入FIFO，并由读使能控制FIFO中数据的读出。写入和读出的操作(高电平有效)由时钟的上升沿触发。当FIFO的数据满和空的时候分别设置相应的高电平加以指示。FIFO是英文First ...
原文：Verilog学习笔记简单功能实现（二）...............全加器
先以一位全加器为例：Xi Yi代表两个加数，Cin是地位进位信号，Cout是向高位的进位信号。列表有： Xi Yi Cin Sum Cout 由左边表格可知： Sum X Y Cin X YCin XY Cin XYCin X Y Cin X Y Cin X Y Cin X Y Cin X Y Cin Cout X YCin XYCin XY Cin XYCin XY X Y Cin 如果取：P ...
2016-09-29 10:10 0 14375 推荐指数：
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