原文:第十二章 ZYNQ-MIZ702 PS读写PL端BRAM

本篇文章目的是使用Block Memory进行PS和PL的数据交互或者数据共享,通过zynq PS端的Master GP 端口向BRAM写数据,然后再通过PS端的Mater GP 把数据读出来,将结果打印输出到串口终端显示。 涉及到AXI BRAM Controller 和 Block Memery Generator等IP的使用。 本系列文章尽可能的让每一个实验都相对独立,过程尽可能保证完整性 ...

2016-09-25 15:00 0 1883 推荐指数:

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第十一章 ZYNQ-MIZ701 PS读写PLBRAM

本篇文章目的是使用Block Memory进行PSPL的数据交互或者数据共享,通过zynq PS的Master GP0端口向BRAM写数据,然后再通过PS的Mater GP1把数据读出来,将结果打印输出到串口终端显示。 涉及到AXI BRAM Controller 和 Block ...

Sun Sep 25 22:26:00 CST 2016 0 4871
第十一章 ZYNQ-MIZ702 DDR3 PS读写操作方案

本编文章的目的主要用简明的方法在纯PS里对DDR3进行读写。 本文所使用的开发板是Miz702 PC 开发环境版本:Vivado 2015.4 Xilinx SDK 2015.4 11.0本难度系数★☆☆☆☆☆☆ 11.1 搭建硬件工程 Step1:新建一个名为 ...

Sun Sep 25 22:55:00 CST 2016 0 2182
第十三章 ZYNQ-MIZ702 PL中断请求

本篇文章主要介绍外设(PL)产生的中断请求,在PS进行处理。 在PL通过按键产生中断,PS接受到之后点亮相应的LED. 本文所使用的开发板是Miz702 PC 开发环境版本:Vivado 2015.4 Xilinx SDK 2015.4 13.0本难度系数★★☆☆☆☆☆ 13.1 ...

Sun Sep 25 23:03:00 CST 2016 0 4184
十二章 ZYNQ-MIZ701 PL中断请求

本篇文章主要介绍外设(PL)产生的中断请求,在PS进行处理。 在PL通过按键产生中断,PS接受到之后点亮相应的LED. 本文所使用的开发板是Miz701 PC 开发环境版本:Vivado 2015.4 Xilinx SDK 2015.4 12.0本难度系数★★☆☆☆☆☆ 12.1 ...

Sun Sep 25 22:35:00 CST 2016 0 2133
第十 ZYNQ-MIZ701 DDR3 PS读写操作方案

本编文章的目的主要用简明的方法在纯PS里对DDR3进行读写。 本文所使用的开发板是Miz701 PC 开发环境版本:Vivado 2015.4 Xilinx SDK 2015.4 10.0本难度系数★☆☆☆☆☆☆ 10.1 搭建硬件工程 Step1:新建一个名为 ...

Sun Sep 25 22:30:00 CST 2016 0 1801
MiZ702学习笔记13——ZYNQ通过AXI-Lite与PL交互

在《MiZ702学习笔记7——尝试自制带总线IP》,我曾提到了AXI4-Lite的简单用法,驱动了下流水灯,只涉及到了写总线。今天,我想利用之前的VGA模块,将AXI4-Lite的读写都应用上。这篇文章主要是思想的介绍,以及AXI4-Lite读的方法。一些细节请先阅读《MiZ702学习笔记 ...

Sun Jan 24 23:35:00 CST 2016 0 4260
第十 MIZ702 ZYNQ制作UBOOT固化程序

10.0难度系数★☆☆☆☆☆☆ 10.1是什么是固化 我们前几章将的程序都是通过JTAG先下载bit流文件,再下载elf文件,之后点击Run As来运行的程序。JTAG的方法是通过TCL脚本来初始化PS,然后用JTAG收发信息,可用于在线调试。但是这样只要一断电,程序就丢失了。还得全部重新 ...

Thu Sep 01 16:20:00 CST 2016 0 3274
 
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