静态时序分析SAT
1. 背景 静态时序分析的前提就是设计者先提出要求，然后时序分析工具才会根据特定的时序模型进行分析，给出正确是时序报告。 进行静态时序分析，主要目的就是为了提高系统工作主频以及增加系统的稳定性。对很多数字电路设计来说，提高工作频率非常重要，因为高工作频率意味着高处理能力 ...
原文：（转）让你彻底理解：静态时序分析
估计面试的时候都会让大家解释一下建立时间和保持时间，几乎所有人都能背出来。建立时间 setup time ：时钟的有效沿到来之前数据必须提前稳定的时间。保持时间 hold time ：时钟有效沿到来之后数据必须继续保持稳定的时间。 我们知道，整个ASIC设计流程主要两个目的：功能和性能。 除了要保证设计的功能，另外一个就是要保证性能。性能通俗的讲，主要是看电路跑得多快，也就是时钟频率有多高。保证性 ...
2016-08-18 07:14 0 2917 推荐指数：
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