Verilog中的文件的读取和写入
在仿真验证的时候，需要一个合适的数据激励，在testbech一个一个的写很麻烦，如果能直接从数据文本里读取，然后输入到已经编写好功能程序中，就很方便。 还有的时候，我们需要将程序输出的内容写到文本里面，然后用其他工具（例如matlab、python等）进行处理。 代码和解释说明如下： ...
原文：Verilog利用$fdisplay命令往文件中写入数据
最近在做的事情是，用FPGA生成一些满足特定分布的序列。因此为了验证我生成的序列是否拥有预期的性质，我需要将生成的数据提取出来并且放到MATLAB中做数据分析。 但是网上的程序很乱，表示看不懂 其实特别简单的一个命令，不知道别人为什么搞那么复杂。 在testbench里面写的主要语句： integer handle 定义后面要用到的变量 ... ... handle fopen data.txt ...
2016-08-17 16:55 0 11451 推荐指数：
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