使用matlab和ISE 创建并仿真ROM IP核
前言 本人想使用简单的中值滤波进行verilog相关算法的硬件实现，由于HDL设计软件不能直接处理图像，大部分过程都是可以将图像按照一定的顺序保存到TXT文档中，经过Modelsim仿真后，处理的数据再经过matlab显示图像；图像首先通过matlab或者C语言保存在TXT文档中，生成测试 ...
原文：ip 核生成 rom 及questasim仿真时需要注意的问题
IP 核生成 ROM 步骤 ：Tools gt MegaWizard Plug In Manager 步骤 ：Create a new custom megafuction variation 步骤 ：Memory Compier gt ROM gt Verilog HDL gt 自定义名称 步骤 ： 步骤 ： 步骤 ： 步骤 ： questasim仿真注意问题 仿真时要注意是否有 altera ...
2016-08-17 15:08 0 2046 推荐指数：
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