Synplify FPGA 逻辑综合
作为 Synopsys FPGA 设计解决方案的一部分，Synplify FPGA 综合软件是实现高性能、高性价比的 FPGA 设计的行业标准。 其独特的行为提取综合技术 (Behavior Extracting Synthesis Technology, BEST) 在将 RTL ...
原文：使用Synplify综合时保留logic
在使用Synplify综合时，此工具会自动优化我的设计。 当然此功能有好有坏，最近有个项目需要使用Chipscope观察内部信号，打开inserter就懵了，信号列表中我的设计有的是名字被改了，有的是干脆给优化没了。 网上当然也有人提出这个问题， 例如http: www.xilinx.com support answers .html 就提供了一个 synthesis syn keep 的语法来保 ...
2016-08-10 10:09 0 3634 推荐指数：
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