FPGA设计之——DDR3
一、硬件设计 1、DDR3颗粒一侧，控制线、地址线线序不能交换； 2、DDR3颗粒一侧，数据线可随意交换； 3、FPGA一侧，控制线、地址线、数据线均有专用引脚，需全部按要求连接。 这样一是为了硬件布线能通，二是保证了FPGA分配引脚时不会乱，按照专用引脚规定的分配即可 ...
原文：DDR3 fly-by拓扑设计
随着数字存储设备数据传输速率越来越快，拓扑结构对于信号质量的影响越来越大，对于DDR 数据传输速率已经达到 Mbps以上，设计采用fly by拓扑结构，但是在使用的过程中我们需要注意一些问题，否则会带来严重的信号完整性和时序问题，导致设计跑不到想要的高速率。 Fly by拓扑要求stub走线很短，当stub走线相对于信号边沿变化率很短时，stub支线和负载就可以看作电容，该电容的大小为stub电容 ...
2016-04-05 14:52 0 3504 推荐指数：
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