Bus，Exclusive access，memory attribute
指令LDREX，STREX是在armv6中新加的指令，配合AMBA3--AXI中的lock[1:0]信号。 在Atomic Access一节中是这么规定的：ARLOCK[1:0]/AWLOCK[1: ...
原文：Bus memory attribute
根据程序的局部性原理，在主存与CPU之间设置的一个高速的容量较小的存储器，叫做cache。 ARM cache架构由cache存储器和写缓冲器 write buffer 组成。其中Write buffer是cache按照FIFO原则向主存写的缓冲器。 cache可以分为Dcache，Icache。分别cache data和 instruction。其中Dcache必须在MMU开启后才能在CP 寄存 ...
2015-07-17 17:53 1 2627 推荐指数：
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