原文:modelsim仿真中 do文件的写法技巧

Modelsim之 DO文件简介 网上的关于DO文件的编写好像资料不多,比较杂,所以本人总结一下常用的简单语法,方便大家查看。其实本人也刚接触DO文件没多久,有纰漏很正常,欢迎指正批评,互相学习。PS:写得有点乱 还有一个值得注意的是 我在看到这篇文章的时候我正在仿真一个verilog文件,文件中调用了一个ROM , 但是我怎么仿真 rom的输出文件都有问题, 经过一个QQ好友的指点,我发现竟然是 ...

2013-01-14 13:34 0 18094 推荐指数:

查看详情

利用do文件方式进行modelsim仿真

举例的工程是一个加法器,待测试功能模块是add.v,测试激励是tb_add.v,do文件是tb.do 下面直接附上主要步骤: (1)首先新建文件夹,如sim_add,在该文件夹下再新建3个文件夹,分别是:sim、tb、src sim:modelsim的工程文件存放,如tb.do tb:测试 ...

Mon Aug 21 18:54:00 CST 2017 0 3050
modelsim脚本仿真中、Wave窗口问题

Modelsim中 view -new-title {*--*} 不能够单独打开窗口 例如: 四个add view都只能显示在一个窗口中 最后发现是版本的问题: 上面使用的是 Modelsim - DE 的版本, 出现不兼容的问题。 需要 ...

Mon Mar 23 20:13:00 CST 2020 0 649
Quartus/Modelsim调试仿真技巧

前几天朋友跟我分享了一些特别好用的调试技巧: 1)System Sources and Probes Editor 类似于模拟激励输入的功能,这段时间一直在做一个电机的驱动,板上没有额外加按键触发,如果初始化时间不够长,串口调试助手一直捕捉不到上电初始化的数据发送,这个功能 ...

Thu Jul 25 18:47:00 CST 2019 0 590
Modelsim中使用TCL脚本编写do文件实现自动化仿真

通常我们使用Modelsim进行仿真,是通过图形界面点点点来进行操作,殊不知Modelsim完美支持TCL脚本语言及批处理命令do文件。简单来说就是从你修改完代码后到你重新编译把需要的信号拉出来查看,现在只需要一个动作即可完成。大大提高了工作效率,博主之前也是点点点了好久,最后 ...

Sun Apr 01 19:13:00 CST 2018 0 2678
仿真激励文件Modelsim仿真测试

前言 TestBench模块没有输人输出,在TestBench模块内实例化待测设计的顶层模块,并把测试行为的代码封装在内,直接对测试系统提供测试激励。 基本的Textbench结构: 我们还 ...

Tue Oct 12 19:05:00 CST 2021 0 863
verilog modelsim文件进行仿真读写

当需要对大量数据进行仿真验证时,可使用文件的读写方式验证; 1.仿真文件读取($readmemb,$readmemh) 1.1二进制文件读取 (1)$readmemb("<数据文件名>",<存储器名>); (2)$readmemb("<数据文件名> ...

Sat Jun 05 03:38:00 CST 2021 0 1731
仿真】后仿真中的notifier是奏啥滴!

在进行后仿真的时候,我们经常会发现有人在仿真命令中增加了“+no_notifier”,从而使输出不定态导致的功能异常出现的情况神奇的消失了。那么,到底是为什么会出现这种情况呢?本文将以示例说明notifier到底是干啥滴! Notifier在英文中的意思是通知人、通告人,在后仿真过程中 ...

Mon Jul 05 01:01:00 CST 2021 2 297
 
粤ICP备18138465号  © 2018-2025 CODEPRJ.COM