Voltage Translation for Analog to Digital Interface ADC http://openschemes.com/2010/03/23/zeroplus-logic ...
今天第一次用Keil的logic analyzer,网上的教程说开了分析仪之后只要从symblo窗口拖变量就可以了,但是发现symblo的特殊函数寄存器里面根本没有GPIO等的变量,发现Peripherals选项卡下面只有CorePeripherals一个选项,于是花了半天时间搞定了,如下图 需要把Dialog DLL下的改成这样,, 后面STM F ZE可以改成需要的STM 型号,什么问题都解决 ...
2012-09-02 15:11 2 21922 推荐指数:
Voltage Translation for Analog to Digital Interface ADC http://openschemes.com/2010/03/23/zeroplus-logic ...
的东西真的太少,比如如何调试的问题,你如何能知道你编写的代码输出是不是你想要的?你如何知道你编写的代码的 ...
在日常工作中,逻辑分析仪和示波器是MCU工程师必不可少的工具,有时候程序有BUG的时候就需要用到这些工具看波形,从而更快地定位到问题所在,进而解决问题。 但是除了成本以外,我们也不可能时时刻刻把这些工具携带在身边,所以keil的软件仿真功能中的逻辑分析仪在这个时候就体现出非凡的意义了。 下面 ...
Xilinx Vivado 提供了上板后的FPGA逻辑分析,信号视图显示等功能。 需要注意,上板后查看信号需要重新综合,并且需要耗费一定的片上布局布线资源。 1. 添加debug信号 可以对模块端口或者wire 变量进行debug信号提取,只要在verilog代码前面添加 ...
逻辑分析仪有三个重要参数:阈值电压、采样率和采样深度。 阈值电压:区分高低电平的间隔。逻辑分析仪和单片机都是数字电路,它在读取外部信号的时候,多高电压识别成高电平,多高电压识别成低电平是有一定限制的。比如一款逻辑分析仪,阈值电压是:0.7~1.4V,那么当它采集外部的数字电路信号的时候,高于 ...
多路分频器设计 在第七节的学习中,笔者带大家通过一个入门必学的流水灯实验实现,快速掌握了VIVADO基于FPGA开发板的基本流程。考虑到很多初学者并没有掌握好Vivado 下FPGA的开发流程,本章 ...
一、例子 我们使用如图1所示的verilog代码所实现的开关电路作为例子。这个电路把DE系列开发板上的前8个开关简单的和对应的8个红色LED相连接。它是这样工作的:在时钟(CLOCK_ ...
首先上一张接线示意图 上方是UART的接线方式,下方则是SPI的 事实上,这样接就能收到信号了 如果是SPI,要设定自己为主机,UART则没有这个问题 下面来说明逻辑分析仪的界面设定 设定介绍完了 下面首先是UART的界面 如果曾经写过UART传输,应该 ...