FPGA内部IP核DDS
项目当中需要正弦信号与余弦信号，首先想到了DDS芯片，例如AD9833、AD9834。由于还需要用FPGA 做一些数据处理，后来干脆直接用FPGA 内部的DDSIP核，同时根据IP核内部的相位累加端口，设置触发信号，使得触发信号更加准时，并且通过PSD 算法计算有效值，相位差更小，精度 ...
原文：FPGA 之 VGA的IP核编写
做一个简单的VGA 超了一天半， 整整七天才搞定，不过也很开心了 加油努力..... 主要分成三个文件: VGA.v 主文件, 同时调用FIFO vga timing.v VGA时序控制文件 vga sdram.v 读取SDRAM内存文件 . VGA.v module VGA input wire clk, input wire reset, 控制寄存器读写 input wire slave ch ...
2012-07-31 14:02 0 3021 推荐指数：
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