从TimeQuest角度看create_generated_clock
，create_generated_clock是用于衍生时钟，TimeQuest作STA分析时会自动计算sour ...
原文：[转]TimeQuest约束外设之诡异的Create Generated Clocks用法
最近在altera FPGA里设计一个外设的驱动模块，模块本身逻辑很简单如下图所示，但是模块和外设之间的时序约束问题搞的很头疼,今天先讲讲总结的一些Timequest下外设约束方法，特别是那毫无用户体验而言的Create Generated Clocks用法。 要让外设正确接收FPGA发出的数据，需要dout和clkout满足外设的建立保持时间，如下图所示。 时序分析是基于源reg的Tco 目的r ...
2012-05-17 10:18 0 7486 推荐指数：
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