FPGA STA(静态时序分析)
1 FPGA设计过程中所遇到的路径有输入到触发器，触发器到触发器，触发器到输出，例如以下图所看到的： 这些路径与输入延时输出延时，建立和保持时序有关。 2. 应用背景 静态时序分析简称STA，它是一种穷尽的分析方法。它依照同步电路设计的要求 ...
原文：静态时序分析（STA）基础
注：上海交大论文 数字电路静态时序分析与设计 学习笔记 第一章 概述 . 集成电路的设计流程 一般集成电路设计步骤分为逻辑设计和物理设计如图 所示： 逻辑设计包括： 系统划分：将一个大规模的系统按功能分成几个功能模块 设计输入：用HDL Hardware Description Language 语言或电路原理图的形式对系统进行功能级描述的设计输入。 功能仿真：对功能级描述进行功能和时序仿真验证并 ...
2012-02-16 11:15 0 10412 推荐指数：
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